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數字設計類EDA

大規模集成電路
設計與驗證

支持SoC芯片規劃與驗證、時序驗證和標准單元庫特征化與驗證，提前預測並預防設計問題，同時可協助客戶高效創建標准單元庫。

電路仿真

數字電路仿真是利用計算機仿真數字電路的工作過程，以驗證設計的正確性和性能。通過軟件仿真電路在不同數字輸入條件下的輸出行爲，可檢查邏輯功能、時序關系和數字電氣特性等。數字電路仿真有助于提前發現和解決設計中的問題，減少實際制造和調試的成本與時間，對芯片設計和现有產品的質量及生產效率具有直接且關鍵性的影響。


概倫先進數字仿真器VeriSim配備高性能的仿真引擎和約束求解器，全面覆盖系統級、行爲級、RTL級和門級數字電路仿真驗證的需求，提供全面的數字設計驗證解決方案。


標准單元庫

標准單元庫 (Standard Cell Library) 是集成電路設計中的重要的標准化電路單元庫，其中包含多種邏輯門電路，用于實現複雜的數字電路設計。標准單元庫通常由芯片制造廠提供，可以優化電路面積、功耗和性能，提高芯片可靠性。


概倫標准單元庫解決方案采用先進的分布式並行架構技術和單元電路分析提取算法，內嵌高精度SPICE仿真器，以快捷、高精的標准單元庫特征化平台NanoCell爲代表，覆盖從標准單元庫自動化設計、庫特征化到驗證的完整設計開發流程。


SoC設計與驗證

SoC設計與驗證涵盖系統級芯片的全面開發過程，從架構設計、IP選擇、集成到功能驗證和性能驗證，全程使用硬件描述語言（如Verilog或VHDL），並借助仿真、驗證工具確保設計的正確性和性能。在IC制造中，SoC設計與驗證起着至關重要的作用。通過提前發現和解決設計中的問題，減少實際制造和調試的成本與時間。


概倫提供以門級晶體管級混合時序分析工具TRASTA爲代表的一系列SoC電路設計與驗證解決方案，可靈活適應不同設計需求和場景，提高芯片設計可靠性、加快现有產品上市時間、降低成本和風險，助力客戶高效完成設計目標。


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