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電路仿真

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VeriSim

VeriSim

先進數字仿真器

數字設計驗證 約束求解器 混合信號驗證解決方案

VeriSim是一款先進的邏輯仿真器，提供全面的數字設計驗證解決方案，覆盖系統級、行爲級、RTL級和門級數字電路仿真驗證的需求。

  • 配備高性能的仿真引擎和約束求解器，旨在提高編譯時效率，並確保設計的正確性和穩定性。

  • 可適配衆多主流硬件描述語言，包括Verilog、VHDL、SystemVerilog、SystemC 等，以及它們的組合。

  • 支持行爲級、RTL級和帶SDF後仿的門級數字電路門級 Verilog和 VHDL仿真。

  • 支持高階的系統級SystemVerilog加SystemC混合仿真，通過無縫集成通用驗證方法（UVM）爲用戶提供快速驗證測試台的設置，使驗證過程更加高效和可控。

  • 提供全面的功能、斷言和代碼覆盖率測試，可生成多種格式的仿真數據。

  • 輸入文件可通過加密算法進行保護，確保客戶 IP得到充分的安全保護。

  • 集成NanoSpice系列的各種晶體管級電路仿真器，提供完整的混合信號驗證解決方案。

下載现有產品單頁

现有產品亮點

  • 高性能 & 大容量

    編譯、仿真和約束求解器引擎創新優化

  • 先進的仿真技術

    X態傳播和競爭條件消除技術

  • 兼容性和可用性

    易于使用並支持從現有工具快速遷移

  • 兼容不同CPU架構

    支持X86和ARM

  • 一站式混合信號驗證解決方案

    與NanoSpice系列晶體管級仿真器集成的
    數模混和信號仿真

现有產品應用

  • 行爲級、RTL級
    和帶SDF後仿的
    門級數字電路

  • 集成NanoSpice
    實現數模混和
    SoC全芯片驗證

  • SystemVerilog
    和SystemC混合語言
    Testbench

  • 系統驗證
    Testbench
    設置

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